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Problème de séquence I2C entre deux PIC
satinas
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#81 Message par satinas » mar. 5 mai 2020 15:11 lien vers la Data-Sheet : Cliquez ici

Tu as essayé de le faire par toi-même et c'est tout à fait louable, mais là faut que cela marche, effectivement :)
Je vais regarder et essayer de faire fusionner nos 2 programmes.

Problème de séquence I2C entre deux PIC
Serge
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#82 Message par Serge » mar. 5 mai 2020 15:13 lien vers la Data-Sheet : Cliquez ici

Bon, je reprend mes essais avec le mode lecture, car ça, ça ne fonctionne pas.

Problème de séquence I2C entre deux PIC
Serge
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#83 Message par Serge » mar. 5 mai 2020 15:13 lien vers la Data-Sheet : Cliquez ici

Ok

Problème de séquence I2C entre deux PIC
Serge
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#84 Message par Serge » mer. 29 juil. 2020 18:44 lien vers la Data-Sheet : Cliquez ici

Petite info de suite....

J'ai bien avancé sur la compréhension du mode "Ecriture", mais pourtant, ça ne fonctionne pas si on force un peu la cadence.
Bien que les registres soient bien contrôlés pour envoyer les séquences d'écriture du maître, ((SSPCON2<<3)+SSPSTAT.2=0)
L'esclave, lui, fait un "OVERFLOW" SSPCON1.6 systématique dès qu'on lui envoie un rythme supérieur à "La SECONDE"
Un siècle quoi !
Pourtant le maitre surveille bien le bus libre avant d'écrire, et l'esclave ne peut pas faire plus court entre deux octets dans l'interruption
ça fonctionne si je temporise le Maaître entre les deux séquences d'une seconde.
En dessous, "OVERFLOW"
Cette erreur SSPCON1.6 est incompréhensible.
Le buffer SSPBUF est vide et pourtant !!!

Code : Tout sélectionner

    if PIR1.3 and not SSPSTAT.5 then
        adresse
=SSPBUF      
        do
        if SSPSTAT.0 then cde
=SSPBUF : exit
        loop
        do
        if SSPSTAT.0 then octet1
=SSPBUF : exit
        loop
        do
        if SSPSTAT.0 then octet2
=SSPBUF  : exit
        loop
        PIR1.3
=0
endif

Je ne trouve pas pourquoi.

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#85 Message par satinas » ven. 31 juil. 2020 16:40 lien vers la Data-Sheet : Cliquez ici

Bonjour,
valeur de FOSC ?
vitesse I2C ?

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#86 Message par satinas » dim. 2 août 2020 12:53 lien vers la Data-Sheet : Cliquez ici

satinas a écrit :Bonjour,
valeur de FOSC ?
vitesse I2C ?


En admettant que FOSC = 4MHz et Fscl = 100kHz, scénario possible :
Le pic exécute 10 instructions durant 1 période SCL.
En fin de réception des 8 bits du dernier octet data, tu fais très vite PIR1.3=0, donc durant le 9ème bit.
A la fin du 9ème bit PIR1.3 repasse à 1, voir datasheet.
Comme PIR1.3 est à 1, l'interruption se relance aussitôt avec SSPSTAT.5 à 1, donc PIR1.3 reste à 1, et l'interruption se relance en permanence, alors qu'il n'y a aucune réception en cours.

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Serge
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#87 Message par Serge » lun. 10 août 2020 15:41 lien vers la Data-Sheet : Cliquez ici

Bonjour.

Ou la, la... Intéressant ta réponse !!!!

J'utilise l'horloge interne à 8Mh
Et mon SSPADD est à $13 (13 en hexa)

SSPSTAT.7=1 (SMP)

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Serge
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#88 Message par Serge » lun. 10 août 2020 20:03 lien vers la Data-Sheet : Cliquez ici

Bonsoir.
J'avance un peu dans mes essais, et mon problème devient celui-ci:

Que je mette de 5 à 24 dans SSPADD du maitre, ne change rien ! ça fonctionne toujours.

Mais j'ai un échange i2c qui n'est pas synchrone sans raison apparente.
J'envoie une séquence i2c de 6 cycles d'horloge de 9 bits comme celle-ci qui dure 1,5ms au total (y compris le temps de traitement de l'esclave)
bus libre
start
"Adresse" (ecriture)
ack
"Code à traiter"
ack
"Octet1"
ack
"Octet2"
ack
re-start
"adresse" (Lecture)
ack
"code à recevoir"
No-Ack
stop
ça, ça fonctionne bien ! de 5 à 24 dans SSPADD du Maitre (j'ai pas testé plus loin)
l'esclave reçoit son adresse, et met PIR1.3 à 1
mon interruption (une seule !) traite les 5 octets reçus, et bloque CKP à 0 pour traiter les données.

Jusque là, tout va bien !
Mais mon incompréhension vient de ce que les cycles du maître (qui ne fait que ça) ne sont pas réguliers.
Toutes les 1/2 secondes, il envoie une séquence pour changer l'état d'une led sur l'esclave.
Et je reçois 5 séquences dans le timing prévu, puis la sixième séquence est décalée d'une demie seconde !!! (quelque soit la valeur mise dans SSPADD)
Voilà ce qui ne marche pas, et le "Maitre" ne fait que ça !
en fait il loupe la sixième séquence( Il attend) sans raison apparente et l'envoie à la septième

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#89 Message par satinas » lun. 10 août 2020 21:49 lien vers la Data-Sheet : Cliquez ici

Bonsoir
- est-ce que le problème persiste si tu ne bloques pas le bus avec CKP, en sautant le traitement ?
- mets sur l'esclave une led qui s'allume durant l'interruption.
- on peut voir le contenu de l'interruption ?

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Serge
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#90 Message par Serge » mar. 11 août 2020 11:41 lien vers la Data-Sheet : Cliquez ici

Bonjour à tous,
Bonjour Satinas.

Si je ne bloque pas CKP pendant le traitement, je provoque un "Owerflow" SSPCON1.6=1 dès que j'envoie des séquences un peu plus soutenues...
(ce n'est pas le cas pour juste la led qui clignotte....
Mais sans bloquer CKP, c'est aussi et toujours pareil, la led clignotte synchro sur les 5 premiers changement d'état, et le sixième est décalé au temps de la 7 ème séquence.

Code : Tout sélectionner

   disable   
Int
:

    if PIR1.3 then

        if not SSPSTAT.5 and not SSPSTAT.2 then   
' si adresse et mode ecriture'
            adresse=SSPBUF
    
            do
                if SSPSTAT.0 then cde
=SSPBUF : exit
            loop

            do
                if SSPSTAT.0 then octet1
=SSPBUF : exit
            loop

            do                            
                if SSPSTAT.0 then octet2
=SSPBUF : exit
            loop

            do
                if SSPSTAT.0 and not SSPSTAT.5 and SSPSTAT.2 then adresse
=SSPBUF : exit  
            loop

            SSPBUF
=cde
            
'SSPCON1.4=0 (   CKP il est à "0" "de fait" après l''envoie de confirmation, il est ici en observation. Il est remis à 1 dans le Programme en fin de traitement)'
 
        else
            poubelle
=SSPBUF
        endif 

        PIR1.3
=0

    endif

    resume
    enable          
    End


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